超聲波氣體流量計研發(fā)探討 七十九
有限狀態(tài)機設計方式有如下優(yōu)勢：
有限狀態(tài)機克服了純硬件數字系統(tǒng)順序方式控制不靈活的缺點。
有限狀態(tài)機為VHDL綜合器盡可能發(fā)揮其強大的優(yōu)化功能提供了有利條件。
狀態(tài)機容易構成性能良好的同步時序邏輯模塊。
在高速運算和控制方面，狀態(tài)機更有其巨大的優(yōu)勢。
狀態(tài)機的可靠性很高。
FPGA對ADC0809進行控制的狀態(tài)機設計由8個狀態(tài)構成，分別為ADC0908初始化、啟動鎖存信號、啟動采樣信號、等待轉換開始、等待轉換結束狀態(tài)、數據輸出允許、數據鎖存和增益算法實現。這幾個狀態(tài)依據ADC0809的控制時序分別進行設計。其中，狀態(tài)3和狀態(tài)4中要對ADC0809的EOC信號線進行測試，在狀態(tài)3時，如果EOC從高電平變?yōu)榈碗娖�，則說明A／D轉換開始，進入狀態(tài)4，否則繼續(xù)等待：在狀態(tài)4時，如果EOC從低電平又變?yōu)楦唠娖�，則說明A／D轉換結束，進入狀態(tài)5，否則繼續(xù)等待。狀態(tài)5和狀態(tài)6將數據輸出到8位數據線上，然后通知FPGA讀取數據，進行增益量計算。各個狀態(tài)之間的轉移由時鐘源模塊提供的5KHz時鐘脈沖完成，每當接收到一個時鐘信號的上升沿時，系統(tǒng)從當前狀態(tài)轉移到下一個狀態(tài)，在狀態(tài)3和狀態(tài)4時可能繼續(xù)停留在當前狀態(tài)。
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